Nios Ii
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1. Técnicas de profiling para o co-projeto de hardware e software baseado em computação reconfigurável aplicadas ao processador softcore Nios II da Altera / Hardware and software codesing profiling techniques based on reconfigurable computing applied to the Altera´s Nios soft core processor
Como avanço dos paradigmas de desenvolvimento de sistemas eletrônicos, novos conceitos, modelos e técnicas resultaram dessa evolução, gerando ferramentas mais eficientes e objetivas. Entre estas, as de automação de projetos eletrônicos (EDA - Electronic Design Automation) em nível de sistema (ESL - Electronic System Level) trouxeram um incremento co
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 21/09/2012
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2. Arquitetura hardware/software de um núcleo NCAP segundo o padrão IEEE 1451.1: uma prova de conceito
Os sensores inteligentes são dispositivos que se diferenciam dos sensores comuns por apresentar capacidade de processamento sobre os dados monitorados. Eles tipicamente são compostos por uma fonte de alimentação, transdutores (sensores e atuadores), memória, processador e transceptor. De acordo com o padrão IEEE 1451 um sensor inteligente pode ser divi
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 06/08/2010
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3. Sistema Embarcado para um Monitor Holter que Utiliza o Modelo PPM na Compressão de Sinais ECG
Neste trabalho, é apresentado o desenvolvimento de um sistema embarcado com prototipagem em FPGA contendo instanciação do processador soft-core Nios II (SOPC System on a Programmable Chip), para um monitor holter que implementa compressão de dados, utilizando o algoritmo PPM, e simula sinais ECG através da implementação das Séries de Fourier. Atravé
Publicado em: 2010
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4. Sistema Telemétrico para Monitoramento de Trens Através de Redes de Sensores sem Fio e Processamento em Sistema Embarcado
Este trabalho apresenta o desenvolvimento de um sistema telemétrico que integra redes de sensores sem fio e processamento de dados em sistema embarcado para monitoramento de veículos em redes de transportes metroferroviários, possibilitando um acompanhamento em tempo real do movimento dos trens. Este sistema tem como principal objetivo permitir uma consta
Publicado em: 2010
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5. Aplicac oes do Modelo qGM na Interpretac ao de Algoritmos Quanticos / THE QGM MODEL APPLICATIONS ON THE INTERPRETATION OF QUANTUM ALGORITHMS
No desenvolvimento de novas tecnologias de informac ao, salienta-se a relevancia da pesquisa direcionada ao conhecimento e a aplicac ao da computac ao quantica, contribuindo para compreensao de questoes importantes de pesquisa como o fenomeno da interfer encia e o paralelismo quantico associado `as transformac oes unitarias. Com o objetivo de colaborar com e
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 18/02/2009
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6. Implementação Hardware/Software da estimação de movimento segundo o padrão H.264
A estimação de movimento é a maior responsável pela redução na quantidade de dados na codificação de um vídeo digital, é também a etapa que exige maior esforço computacional. O padrão H.264 é o mais novo padrão de compressão de vídeo e foi desenvolvido com o objetivo de dobrar a taxa de compressão em relação aos demais padrões existentes
Publicado em: 2008
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7. A power estimation design for the Altera Nios II processor / Projeto de um estimador de potência para o processador Nios II da Altera
Nowadays, optimization of hardware and software systems does not necessarily mean increasing their computational performance. Due to the popularization of battery-operated embedded systems, energy comsumption has become a very critical issue. Several tools have been created to model, optimize, and estimate energy consumption, allowing power constraints to be
Publicado em: 2007
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8. Analysis and implementation of SMP support (symmetric multiprocessing) for eCos operating system with application in mobile robotics / Análise e implementação de suporte a SMP (multiprocessamento simétrico) para o sistema operacional eCos com aplicação em robótica móvel
Technological development has significantly reduced the distance between the performance of systems designed using reconfigurable computing and dedicated hardware. The main sources of performance are the high density level of the FPGAs and the resources? improvement offered by manufacturers, who make more its use more attractive in a variety of applications,
Publicado em: 2007
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9. Projeto de um sistema para monitoramento de hardware/software on-chip baseado em computação reconfigurável / A on-chip hardware/software monitoring system based on reconfigurable computing
A tendência de integração de diversos componentes em um único chip tem proporcionado um aumento da complexidade dos sistemas computacionais. Tanto as indústrias quanto o meio acadêmico estão em busca de técnicas que possibilitem diminuir o tempo e o esforço gastos com a verificação no processo de desenvolvimento de hardware, a fim de garantir qual
Publicado em: 2007
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10. Aquarius â Uma plataforma para desenvolvimento de sistemas digitais dinamicamente reconfigurÃveis
HÃ um grande interesse por parte dos pesquisadores em relaÃÃo Ãs caracterÃsticas de autoreconfiguraÃÃo e auto-adaptaÃÃo presentes em plataformas modernas de hardware baseadas em dispositivos lÃgicos dinamicamente reconfigurÃveis FPGAs (Field Programmable Gate Arrays). Alguns destes dispositivos apresentam caracterÃsticas ainda mais especÃficas,
Publicado em: 2007
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11. Projeto e implementação de circuitos classificadores digitais com controle da generalização baseado na regra do vizinho-mais-próximo modificada
This work aims at the implementation of classifying binary patterns with digital circuits in order to get a embedded system with the following features: portability, on-line training, operating in real time and with capacity of generalization. The proposed method makes use of training data filtering (or selection) before digital circuit synthesis. It is prop
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 22/02/2006
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12. Phoenix um framework para trabalhos em síntese de alto nível de circuitos digitais
Este trabalho descreve o desenvolvimento de um framework de código aberto para síntese de circuitos digitais, para uso em projetos de hardware/software co-design. O framework consiste de um compilador que aceita ANSI C como código fonte e que permite a construção de um dado sistema e sua execução em hardware. Este compilador, intitulado Phoenix, permi
Publicado em: 2006