Pll Adaptativo
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1. Estratégia de controle robusto para filtro ativo paralelo sem detecção de harmônicos de correntes
Resumo: As estratégias de controle convencionais de filtros ativos de potência paralelos (FAPP) empregam esquemas de detecção de harmônicos em tempo real, usualmente implementados com filtros digitais. Isso aumenta o número de sensores na estrutura do filtro, o que resulta em altos custos. Além disso, esses esquemas de detecção introduzem atrasos qu
IBICT - Instituto Brasileiro de Informação em Ciência e Tecnologia. Publicado em: 11/02/2011
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2. Estimação de frequência usando sensores de erro com atrasos adaptativos
Neste trabalho é proposta uma solução para a melhoria no desempenho dos Early Error Sensing (EES) Adaptive Time Delay Tanlock Loops (ATDTL) de 1ª ordem apresentados em (Al-Zaabi et al., 2005), quanto a estimação de frequência e tempo de captura. Os EES-ATDTL são Phase-Locked Loops (PLL) digitais utilizados para implementações em hardware, devido à
Sba: Controle & Automação Sociedade Brasileira de Automatica. Publicado em: 2011-08
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3. Malha síncrona digital "Tanlock" com estimação de frequência e ganho adaptativo para convergência rápida. / Adaptive gain time delay Tanlock loop with frequency estimation and fast convergence.
Nas últimas três décadas os phase locked loops (PLLs) totalmente digitais têm recebido muita atenção devido, principalmente, às vantagens que eles oferecem em comparação aos PLLs analógicos. Essas vantagens incluem melhor desempenho, maior velocidade e confiabilidade, tamanho reduzido e menor custo. Os PLLs também são amplamente utilizados em sis
Publicado em: 2011